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• ococ 2020-02-18 05:52

Xilinx Spartan-6 FPGA SP605 价格多少合理？

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• ococ 2020-02-18 04:42

综合的时候报错，没办法解救

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• ococ 2020-02-18 02:39

spartan-6 MCB写入和读出不一致

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• ococ 2020-02-18 01:30

一段VHDL程序，仿真正确，下载后不正确

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• ococ 2020-02-18 01:08

一个有关Xilinx microblaze简单语法的问题

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• ococ 2020-02-17 23:57

能否用VERILOG写TB去测试VHDL的代码？

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• ococ 2020-02-17 23:54

求助！！！编译，下载都可以，但程序就是不运行，连顶层

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• ococ 2020-02-17 21:33

VHDL编译时出现问题，求大神解读

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• ococ 2020-02-17 20:41

modelsim10.2C破解后提示错误，以及如何进行verilog vhdl混合仿真

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• ococ 2020-02-07 18:23

Spartan6 MCB发烫问题

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• ococ 2020-02-07 14:22

FPGA画面拼接方案

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• ococ 2020-02-07 03:11

怎么在CLK下将多个周期内的脉冲边沿分别提取出来？如下图

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• ococ 2020-02-07 02:15

两种写发，感觉应该更稳定，却出现了问题

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• ococ 2020-02-07 01:31

悬赏现金解决时钟同步的问题

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• ococ 2020-02-07 00:01

lattice 器件&开发环境