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• jytan_yjs11 2020-02-18 10:11

xilinx或Altear管脚锁定能否同AD9同步

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• jytan_yjs11 2020-02-18 06:26

FPGA资料集合

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• jytan_yjs11 2020-02-18 06:11

求助。如何编写程序检测10010序列

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• jytan_yjs11 2020-02-18 04:38

xilinx或Altear管脚锁定能否同AD9同步

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• jytan_yjs11 2020-02-18 03:28

就想用最小的CPLD器件产生个m序列，熟练的兄弟给指导个

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• jytan_yjs11 2020-02-18 00:51

xilinx或Altear管脚锁定能否同AD9同步

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• jytan_yjs11 2020-02-17 20:49

VHDL设计举例：伪随机数产生器

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• jytan_yjs11 2020-02-01 16:47

FPGA开发板原理图+PCB