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• EDAbuffalo 2020-03-02 10:50

关于PROCESS语句中敏感量问题，求证。

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• EDAbuffalo 2020-02-29 18:49

端口映射的问题

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• EDAbuffalo 2020-02-28 23:52

计数器为什么会错位

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• EDAbuffalo 2020-02-26 12:24

存储问题

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• EDAbuffalo 2020-02-25 20:25

cpld写lcd的时序，第一次写vhdl，大家帮忙看看有问题没

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• EDAbuffalo 2020-02-25 00:28

求助：结构体中使用signal和variable最后综合有什么区别呢

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• EDAbuffalo 2020-02-24 01:20

请教一个奇怪的问题

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• EDAbuffalo 2020-02-23 20:30

3个if then 连续 执行顺序是怎么样的啊

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• EDAbuffalo 2020-02-23 19:55

请问quartus13这个版本下则么使用vmf文件仿真？

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• EDAbuffalo 2020-02-23 12:58

我的wr clk怎么产生

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• EDAbuffalo 2020-02-19 18:54

举例说明VHDL中关于变量和信号的赋值、if语句的描述方法

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• EDAbuffalo 2020-02-17 20:33

请教一个RapidIO消息传输的问题

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• EDAbuffalo 2020-02-03 16:50

小白的问题 qsf 管脚分配

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• EDAbuffalo 2020-02-03 14:39

在没有源工程的情况下如何烧写nios 程序？？？？