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• 00750 2019-03-26 00:40

D触发器设计同步计数器

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• 00750 2019-03-26 00:18

actel FPGA的第一个实验失败的，大家帮忙看看呢！谢谢了

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• 00750 2019-03-26 00:04

CPLD开发安装软件的问题

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• 00750 2019-03-25 23:07

OC电路能驱动继电器么？求一份设计图，或者详细说明。

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• 00750 2019-03-25 22:50

FPGA inout口时序仿真没有输出

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• 00750 2019-03-25 21:55

cpld与fpga的一点疑问

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• 00750 2019-03-25 21:52

mem型变量位操作怎么写？

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• 00750 2019-03-25 21:08

如何进行CPLD内部的地址定义

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• 00750 2019-03-25 18:54

问个wire定义问题

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• 00750 2019-03-25 18:34

谁玩过RS232，请进

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• 00750 2019-03-25 18:10

功能仿真正确，下载后不对，为什么呀？

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• 00750 2019-03-25 18:02

verilog中得memory型变量的综合

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• 00750 2019-03-25 17:52

CPLD开发安装软件的问题

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• 00750 2019-03-25 17:47

数码管做电子钟

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• 00750 2019-03-25 16:25

CPLD没有复位信号输入，怎么用代码生成一个复位信号