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• houxiaoxiao 2019-07-16 07:58

想做一个基于FPGA的高速信号处理系统，求指导思路。。

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• houxiaoxiao 2019-07-16 07:50

VHDL中怎么用语句实现在不同情况下对同一个信号赋不同值？

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• houxiaoxiao 2019-07-16 07:40

测试文件和.v程序的时间不一致怎么弄

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• houxiaoxiao 2019-07-16 07:23

FPGA的查找表怎么用呀

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• houxiaoxiao 2019-07-16 07:17

FPGA的rom存储方式是什么？

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• houxiaoxiao 2019-07-16 06:40

请问下面代码哪里有问题

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• houxiaoxiao 2019-07-16 05:41

我正在学习基于FPGA的数据采集系统，请各位大神提供些有关这方面的资料（Verilog HDL代码）

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• houxiaoxiao 2019-07-16 05:32

计数器，计数到一个值就不计数了！这么回事

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• houxiaoxiao 2019-07-16 04:21

一段verilog程序，大家帮看一下 那里错了

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• houxiaoxiao 2019-07-16 03:58

帮我看看下面这段程序哪里有错

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• houxiaoxiao 2019-07-16 03:51

想做一个数字钟,但是给了这样的电路,输出很奇怪.

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• houxiaoxiao 2019-07-16 03:47

FPGA输出引脚全为高电平

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• houxiaoxiao 2019-07-16 03:41

求大神解答，关于modelsim仿真的问题

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• houxiaoxiao 2019-07-16 03:29

ps/2键盘接口和FPGA进行连接时，按键按下数码管不显示

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• houxiaoxiao 2019-07-16 03:17

ps/2键盘接口和FPGA进行连接时，按键按下数码管不显示