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• eeleader 2019-03-25 23:49

第一次编程就出错了

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• eeleader 2019-03-25 23:47

if() 内的判断条件 可以用 | 和 & 么？

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• eeleader 2019-03-25 23:45

modelsim和quatus ii联合仿真

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• eeleader 2019-03-25 23:43

用XST综合工具check syntax工程时，提示如下错误

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• eeleader 2019-03-25 23:42

CPLD与CPU通信问题

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• eeleader 2019-03-25 23:41

一段vorilog 代码看不懂，望帮忙解答

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• eeleader 2019-03-25 23:40

关于CPLD的问题。

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• eeleader 2019-03-25 23:40

FPGA配置RAM时没有3端口RAM怎么回事

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• eeleader 2019-03-25 23:37

eeleader斑竹请进！

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• eeleader 2019-03-25 23:36

能读FPGA配置芯片里的程序吗？

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• eeleader 2019-03-25 23:33

用FPGA设计数字时钟怎么实现 急

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• eeleader 2019-03-25 23:32

基于FPGA的数字电压表的设计的程序

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• eeleader 2019-03-25 23:32

cyclone iv 系列的fgpa引脚设定为as output deriving ground 测

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• eeleader 2019-03-25 23:32

序列检码器 状态机 的一点小疑问

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• eeleader 2019-03-25 23:31

简单数字钟设计