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• 玄德 2020-02-02 22:22

硬件工程师有必要学FPGA吗？

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• 玄德 2020-02-02 18:04

这个latch我怎么也看不出来怎么产生的

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• 玄德 2020-02-02 17:16

初学Verilog，出现的错误解决不了，求帮忙

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• 玄德 2020-02-02 17:15

一个语法问题

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• 玄德 2020-02-02 16:00

testbench的设置问题

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• 玄德 2020-02-02 15:40

CYCLONE II 配置时IO电平可以更改吗

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• 玄德 2020-02-02 15:30

硬件工程师有必要学FPGA吗？

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• 玄德 2020-02-02 14:15

结束

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• 玄德 2020-02-02 14:11

XC95144XL做的项目，可以用EPM240代替吗

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• 玄德 2020-02-02 13:45

FIFO内部动过的时序问题？

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• 玄德 2020-02-02 12:27

xilinx IO 口问题，请高手指点

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• 玄德 2020-01-30 21:09

FPGA中这个原理图是什么意思

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• 玄德 2020-01-27 16:42

Quartus II 13.0. 0.156.qdz devices

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• 玄德 2020-01-27 13:05

Quartus II 13.0. 0.156.qdz devices

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• 玄德 2020-01-26 22:12

开启Xilinx Spartan 6的DDR3之路 - 20160823更新