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• 牛哥哥要炸天 2019-07-16 13:31

ModleSim仿真的时候有一个信号不能被赋值

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• 牛哥哥要炸天 2019-07-16 13:25

FPGA verilog浮点数运算

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• 牛哥哥要炸天 2019-07-16 12:13

请大神帮我看一下FPGA的电动机代码写的对不对？急用

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• 牛哥哥要炸天 2019-07-16 11:47

FPGA实现逻辑函数用的什么电路结构？

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• 牛哥哥要炸天 2019-07-16 11:39

关于锁相环中输出选取的问题

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• 牛哥哥要炸天 2019-07-16 06:40

fpga新手求助，crc校验部分的内容遇到了些困难希望有人可以解答

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• 牛哥哥要炸天 2019-07-16 05:02

SDRAM片选信号可以接地吗

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• 牛哥哥要炸天 2019-07-16 03:16

新手问题 FPGA

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• 牛哥哥要炸天 2019-07-16 02:29

FPGA视频编码

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• 牛哥哥要炸天 2019-07-16 00:42

关于锁相环中输出选取的问题

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• 牛哥哥要炸天 2019-07-16 00:40

将单片机的8位数据通过fpga锁存器组成64位的数据写到ram,经常写错，会是哪的问题？

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• 牛哥哥要炸天 2019-07-16 00:37

哪位大神做过FPGA实现OFDM的？求咨询！！~

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• 牛哥哥要炸天 2019-07-16 00:24

fpga计数延时该如何实现

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• 牛哥哥要炸天 2019-07-15 23:07

counter_out[19:1]这是上次数据的前18位，也就是1/2解释一下

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• 牛哥哥要炸天 2019-07-15 21:35

新人论文求救。