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• zw260132324 2019-07-16 22:45

做多通道数据同步采集用哪个系列的fpga功耗低？

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• zw260132324 2019-07-16 09:26

请教一下怎么用FPGA实现1g方波，我只知道需要设置ALTPLL，请各位高手指点

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• zw260132324 2019-07-16 09:25

Verilog程序如下，怎么修改可以增大运行的频率？求大神解答

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• zw260132324 2019-07-16 03:33

VHDL 语句用法求解myramup(datacnt)(3 downto 0)

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• zw260132324 2019-07-16 02:56

求解答啊为什么这两个模块在模块里话后会出错啊，求大神解决！

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• zw260132324 2019-07-16 00:38

请问能用FPGA直接连接CAN收发器吗？

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• zw260132324 2019-07-15 23:59

quartus ii 9.0 verilog 仿真报错，求助

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• zw260132324 2019-07-15 23:34

Verilog中#号的用法请教

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• zw260132324 2019-07-15 22:33

vdhl语言，请教咋编译不通过

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• zw260132324 2019-07-15 22:11

为什么在FPGA中读取FIFO时，读的第一个数据和第二个数据之间会有两个时钟周期的延迟呢？