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• FPGALOVER 2019-07-17 04:52

关于RTL仿真和门级仿真求助~

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• FPGALOVER 2019-07-16 11:23

ISE14.7 双端口RAM IP核问题

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• FPGALOVER 2019-07-16 09:24

求分析两段简单的verilog的计数器的代码写法上的不同会带来什么不同的效果，

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• FPGALOVER 2019-07-15 23:48

xilinx A7 200t PCI协议使用问题

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• FPGALOVER 2019-07-15 23:38

VHDL中移位运算符的实现之SLL使用

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• FPGALOVER 2019-07-15 22:38

一直看不懂有问号的三行语句是什么意思，大神能不能指导一下?

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• FPGALOVER 2019-07-15 22:16

CPLD 下降沿触发信号