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• 白丁 2019-03-25 14:08

fpga 锁相环解调调频

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• 白丁 2019-03-25 14:00

fpga 怎么读取epcs 里的id

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• 白丁 2019-03-25 13:44

做FPGA设计有必要学习SystemVerilog？

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• 白丁 2019-03-25 13:32

新人刚到，有个机械臂方案想用soc，大家参谋参谋

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• 白丁 2019-03-25 13:30

SATA资料共享

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• 白丁 2019-03-25 13:30

我想设计一款控制大棚智能控制系统

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• 白丁 2019-03-25 13:30

在keil中遇到的问题

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• 白丁 2019-03-25 13:28

为什么FPGA引脚全都输出高电平

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• 白丁 2019-03-25 13:17

关于FPGA的数字信号处理

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• 白丁 2019-03-25 13:15

这个相位检测算法可以用verilog hdl描述吗？

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• 白丁 2019-03-25 13:14

在编写乘法器编译时没有继承宽度的问题，求教大神

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• 白丁 2019-03-25 13:14

大二小学渣求助，在线等回复

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• 白丁 2019-03-25 13:12

RTL图显示5‘NC

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• 白丁 2019-03-25 13:08

请问黑金的fpga开发板怎么和ds18b20连接

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• 白丁 2019-03-25 13:03

crc（x^5 + x^4 + x^2 + 1）用verilog串行实现调出不了，请高手来帮我！