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• Goself 2019-03-26 17:09

求做FPGA算法的同行

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• Goself 2019-03-25 23:40

一个ds18b20的verilog程序，提示有错误，大家帮忙看一下

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• Goself 2019-03-25 20:35

有关Xilinx ISE 13.4 XST的问题

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• Goself 2019-03-25 19:45

异步时域数据处理

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• Goself 2019-03-25 19:22

verilog语句输出疑问

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• Goself 2019-03-25 16:28

if ((P1 & 0x07) != 0x07)什么含义？

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• Goself 2019-03-25 16:11

新手学习问题

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• Goself 2019-03-25 15:45

FPGA的原理图输入方式和vhdl区别

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• Goself 2019-03-25 15:34

一个ds18b20的verilog程序，提示有错误，大家帮忙看一下

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• Goself 2019-03-25 15:32

程序有点问题

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• Goself 2019-03-25 14:58

基于FPGA的棋类比赛计时器

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• Goself 2019-03-25 13:16

FPGA时钟输出问题

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• Goself 2019-03-25 04:43

单片机主从机通讯问题

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• Goself 2019-03-25 04:39

if ((P1 & 0x07) != 0x07)什么含义？

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• Goself 2019-03-25 03:39

单片机编程思路问题