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• cuianbin 2020-02-28 18:39

有大神做过DDR2模型的Modelsim 仿真没有呢？

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• cuianbin 2020-02-28 18:32

源时钟和目的时钟为什么相差一个clock？

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• cuianbin 2020-02-28 18:32

分享：任意奇数分频（50%占空比） verilog 代码

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• cuianbin 2020-02-28 18:25

请搞过PCI9054的朋友进来看看

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• cuianbin 2020-02-27 21:12

FPGA 读SRAM 时候的注意事项（原创）

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• cuianbin 2020-02-27 21:10

Modelsim ROM ip 仿真 原创哦

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• cuianbin 2020-02-24 20:38

拜拜FPGA!

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• cuianbin 2020-02-17 19:57

MIG 产生DDR2_SDRAM 总结（大牛就不要看啦 ）

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• cuianbin 2020-02-17 19:50

有做过stm32 和FPGA 用FSMC通讯的么？

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• cuianbin 2020-02-17 19:50

光模块 在不插光纤的时候 ，serdes能接收到其发过来的数据

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• cuianbin 2020-02-06 11:25

EP3C16Q240C8N 短路，求助！

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• cuianbin 2020-02-03 10:17

有玩zynq 的么？

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• cuianbin 2020-02-02 11:38

DDR2 突发读写遇到问题。

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• cuianbin 2019-03-25 09:58

研究生 自学FPGA的困惑，各位有没有和自己一样苦恼的？