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• youwozuozhujun 2019-07-17 13:02

此程序是基于限幅滤波降低PAPR的程序。BER仿真一直出现问题。大佬们帮小弟看看好不

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• youwozuozhujun 2019-07-15 21:47

利用QutartusII15.0设计一个直通器 输入数据锁存 然后直接输入

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• youwozuozhujun 2019-07-15 21:47

verilog设计冗余插入模块

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• youwozuozhujun 2019-07-15 21:46

仿真结果为啥步正确呢？？？

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• youwozuozhujun 2019-07-15 21:41

modelsim is exiting with code 7???

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• youwozuozhujun 2019-07-15 21:41

详细讨论异步FIFO的具体实现？？？