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• 叫我阿gu就好 2019-11-21 13:41

FPGA 高速信号

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• 叫我阿gu就好 2019-07-15 20:57

用vivado 综合实现完以后，wns和tns都负的过大。有没有具体的方法找到问题然后修改？

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• 叫我阿gu就好 2019-07-15 20:44

修改VIVADO ip核

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• 叫我阿gu就好 2019-07-15 20:40

基于FPGA的TDC设计，求具体的设计实例参考

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• 叫我阿gu就好 2019-07-15 20:40

vivado2017.3为什么网上找不到安装包

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• 叫我阿gu就好 2019-07-15 20:37

ISE中的net load delay是什么意思