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FPGA时钟处理

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今天做了一个小程序，完成FPGA和DSP之间的数据传输，即FPGA产生一个数据使能、开始标志以及8位的数据，当有中断响应的时候，传输给DSP，之后DSP再将此组数据传递给FPGA。 在这个程序中出现了两个输入时钟，一个FPGA的系统时钟，另一个是DSP输出数据的时钟，两个时钟频率不同，且不同步。所以需要对DSP的输出时钟进行处理，将DSP_CLK时钟拉入全局时钟网络，这里使用原语BUFG进行处理。...

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VC工程文件说明

• 阿飞 发布于
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 dsw, aps, clw, plg这些文件都可以删除。只保留 H，C，CPP，DSP，RC，剩余文件去除只读属性，其余全部删除。然后打开DSP 有提示选 YES，就可以了 *.dsp(DeveloperStudio Project)：是VC++的工程配置文件,比如说你的工程包含哪个文件,你的编译选项是什么等等,编译的时候是按照.dsp的配置来的。*.dsw(DeveloperStudio Wo...