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DSP TMS320F2812验证平台制作日志1

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近年来，随着嵌入式技术的飞速发展，各类处理器也层出不穷，对于处理器的软件仿真技术应运而生。软件仿真为处理器开发节省了大量的成本并极大提高了研发的速度，因此，软件仿真成为如今嵌入式中相当关键的一部分。 能否给出正确的仿真结果决定了一款仿真软件的成功与否，因此需要有一个验证平台及大量的测试用例来对仿真软件进行验证。   本设计围绕TMS320F2812数字信号处理器，对现有的精确至周期的处理器仿真模型...

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verilog HDL 计数器

• baoyansheng 发布于
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1.二进制法六十进制计数器module timer( input clk, output reg[5:0] counter //转化为二进制有几位 );parameter i=59; //宏定义任意进制计数器always@(posedge clk)  begin     if(counter == i)            counter