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allegro入门笔记-PCB板框的绘制与封装的对应

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    接着上讲笔记来谈，当我们绘制完毕元器件对应封装封装时候，下一步就是将我们之前完成原理图部分的网表导入（file/import/logic，导入路径为CIS工具所生成网表，一般情况下在其工作目录的Allegro文件夹下，其中主要包含三个pst~.dat文件）到Allegro中，此时Allegro中仅仅包含各字符串所代表的元器件之间的逻辑关系，所以我们需要在setup/UPE/paths/li...

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arm与dsp通信

• 吉祥凌 发布于
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                       DVSDK双核异构通信环境搭建 1.到TI官网下载源码dvsdk_dm3730-evm_4_00_00_22_setuplinux（需要注册用户），板子给的demo中也有改软件包（我的路径:G:Project_Programlinuxdemodvsdksource）。 2.将下载的源码拷贝到Linux,用 chmod +x dvsdk_dm3730-e...

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linux开发/学习的一点感想

• 吉祥凌 发布于
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最近一个客户拿着他的linux系统来向我求救。那是一个S3C2440的linux项目。具体情况就是：系统反应速度太慢，用了一阵以后输出的声音就像被卡住了一样，一个字拖的很长。他用的是2.6的内核，按理来说2.6的内核实时性应该不错啊，其调度算法复杂度是O(1)，而且支持内核抢占，虽然说不是一个硬实时的系统，但其软实时还是有保证的，而且他这个项目对实时性根本没什么要求。拿过来一分析发现：   1.应...